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Evitando metaestabilidade na prática - VHDL

Este artigo irá apresentar um projeto em VHDL de uma cadeia de flip flops de sincronismo para evitar a metaestabilidade em FPGAs. Confira!

Criando seu primeiro projeto RTL no Xilinx Vivado Design Suite

Confira neste artigo um tutorial rápido para programação RTL de FPGAs/SoCs da Xilinx utilizando o Vivado. É usada a Zybo board, com SoC Zynq 7000 da Xilinx.
VHDL2008

Migrando para VHDL2008

VHDL2008 ainda é novidade   O VHDL2008 já está faz 9 anos à disposição de todos os desenvolvedores de HDL. Porém, ainda é pouco utilizada nos...
Zybo-board-destaque

Conheça a Zybo board: ARM e FPGA em uma única placa

Há algum tempo atrás foi noticiado aqui no embarcados a nova geração de FPGAs contendo os novos System-on-Chip (SoCs) da Altera...

Dica de livro: VHDL - Descrição e Síntese de Circuitos Digitais

Confira o livro "VHDL – Descrição e Síntese de Circuitos Digitais", que ensina a linguagem de descrição de circuitos digitais de forma didática.

Placa de FPGA com Cyclone IV

Em se tratando de kits de desenvolvimento com FPGA, encontramos diversos modelos e marcas, porém quando usamos quesito baixo custo como filtro surgem poucas...

Organize sua Biblioteca em Lógica Programável

Aprenda a gerenciar biblioteca em Lógica Programável, tão importante quanto saber trabalhar tecnicamente com isso. Sem isso, o time todo falha.

Instalando Xillinux na ZedBoard

Para o desenvolvedor que busca facilidade, confira como instalar o Xillinux na ZedBoard, uma boa opção de Linux para essa placa.

Como estruturar projetos em FPGA e VHDL - Parte 2

Introdução   No artigo anterior, eu comentei sobre algumas questões de relógio e temporização. Isso ao mesmo tempo não tem nada a ver com...

Como estruturar projetos em FPGA e VHDL

Confira como estruturar projetos em FPGA e VHDL. Apesar de ser um tema que desperta muita curiosidade, pouca gente segue trabalhando com isso. Por quê?

Simulando sua primeira porta AND com ISE Design Suite

O FPGA é uma tecnologia muito interessante, com capacidade de fazer desde pequenas lógicas, até processadores inteiros (vide o artigo AHMES, do...

Implementação do Ahmes num FPGA Cyclone IV da Altera

Olá, no meu primeiro artigo sobre o Ahmes nós vimos o modelo de programação da CPU, o código VHDL e a simulação da...
The Microzed Chronicles: livros sobre FPGAs

Livros grátis sobre FPGAs da linha Zynq: The Microzed Chronicles

Hoje estão disponíveis para download, sem nenhum custo, dois livros sobre FPGAs, em específico como trabalhar com FPGA da linha Zynq da Xilinx. Trata-se...

Parallax Propeller 1: Microcontrolador Open Source

A empresa Parallax lançou em 2006 a primeira geração de seus processadores Multicore chamados de Parallax Propeller 1, ou P8X32A. Em 2014 anunciou esse...

Livro Grátis sobre o FPGA XILINX Zynq-7000

Há algum tempo foi disponibilizado um livro grátis para download em inglês sobre os FPGAs da XILINX da linha Zynq. O livro chamado simplesmente...
Quartus-Prime-destaque

Reduza o tempo de desenvolvimento de projetos em FPGA com o novo Quartus Prime...

Um ciclo de desenvolvimento de projeto para FPGA deve ser dividido em etapas, e a forma mais usual de se fazer esta divisão pode...

Placa Terasic Cyclone V GX Starter Kit

A Terasic lançou há alguns meses mais uma placa de baixo custo para desenvolvimento rápido com o FPGA Cyclone V da Altera, a placa...

Spartixed - Uma placa para você aprender a codificar em VHDL e Verilog

Uma placa equipada com FPGA da XILINX chamou a atenção no Kickstarter. A Startixed é uma placa que promete ser uma plataforma de fácil...

Tutorial de Verilog: Meio Somador (Half Adder)

Dando prosseguimentos aos tutoriais de Verilog, apresento neste post o Meio Somador de 1-bit, ou Half Adder em inglês. O circuito meio somador é...
altera stratix 10 fpga

FPGAs Altera Stratix 10

Suporte da Macnica para os FPGAs Altera Stratix 10  A família Stratix® 10 de FPGAs Altera apresenta vantagens inovadoras em desempenho, eficiência energética, densidade e...

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Data: 25/10 às 14:00 | Apoio: Renesas
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